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2021三位二进制同步加法计数器的设计.docx

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三位二进制同步加法计数器的设计1三位二进制同步加法计数器的设计(000,111)1.1课程设计的目的:1、了解同步加法计数器工作原理和逻辑功能。2、掌握计数器电路的分析,设计方法及应用。3、学会正确使用JK触发器。1.2设计的总体框图:C图1.1六进制加法器1.3设计过程:1状态图:图1.2六进制加法状态图2时序图:CP:Q2:Q1:Q0:Y:图1.3六进制加法的波形图3选择的触发器名称:选用三个CP下降沿触发的边沿JK触发器74LS112输出方程:图1.4输出Y的卡诺图Y=Q2nQ1n4图1.5六进制同步加法计数器的次态卡诺图5各个触发器次态的卡诺图Q1nQ0nQ2n0001111001图1.6Q2n+1的卡诺图Q1nQ0nQ2n0001111001图1.7Q1n+1的卡诺图Q1nQ0nQ2n00011110016由卡诺图得出状态方程为:Q2n+1=Q1nQ2n+Q1nQ0nQ2nQ1n+1=Q0nQ1n+Q2nQ0nQ1nQ0n+1=Q0n(1)驱动方程:2J=Q1nQ0n1J=Q0n0J=12K=Q1n1K=Q2nQ0n0K=17.检查能否自启动:/0/1111000001(有效状态)图1.8检测能否自启动1.4设计的逻辑电路图:图1.9六进制加法计数器的电路图1.5设计的电路原理图:图1.10六进制加法计数器的原理图1.6实验仪器:(1)数字原理实验系统一台(2)集成电路芯片:74LS08一片74LS00一片74LS112三片1.7实验结论:经过实验可知。

满足时序图的变化,且可以进行自启动。实验过程中很顺利,没有出现问题。0/02串行序列信号检测器的设计(检测序列0111)2.1课程设计的目的:1、了解串行序列信号检测器的工作原理和逻辑功能2、掌握串行序列信号检测器电路的分析,设计方法及应用。3、学会正确使用JK触发器。2.2设计的总体框图:CPY输入脉冲串行序列输出图2.1信号检测器2.3设计过程:1原始状图:S4图2.2信号检测器的原始状态图2最简状态图:(根据表11合并等价状态):图2.3最简原始图表113进行状态分配,画出二进制数编码后的状态图:(1)进行状态编码,取S0=00S1=01S2=10S3=11(2)码后编的状态图:4选择的触发器名称:选用两个CP下降沿触发的边沿JK触发器74LS1125采用同步的方案。

即取:CP0=CP1=CP6输出方程:图2.5输出Y的卡诺图Y=xQ1nQ0n7状态方程:图2.6串行序列信号检测器的次态卡诺图Q1nQ0nX0001111001图2.7Q1n+1的卡诺图Q1nQ0nX0001111001图2.8Q0n+1的卡诺图8由卡诺图得出状态方程为:Q1n+1=XQ0nQ1n+Q0nQ1nXQ0n+1=XQ1nQ0n+XQ0n9驱动方程:1J=XQ0n0J=XQ1n1K=XQ0n0K=X2.4设计的逻辑电路图:2.5设计的电路原理图:2.6实验仪器:(1)数字原理实验系统一台(2)集成电路芯片:74LS00一片74LS04三片74LS08一片74LS11一片74LS112两片2。

7实验结论:经过实验后可知,满足设计效果。参考文献[1]余孟尝.《数字电子技术基础简明教程》.高等教育出版社,出版年:2007年12月[2]吴翔.苏建峰.《Multisim10&Ultiboard原理图仿真与PCB设计》.电子工业出版社,出版年:2008年1月[3]张利萍,王向磊.《数字逻辑实验指导书》.信息学院数字逻辑实验室,2009年

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